PCB十二层板加工

高速PCB设计指南之二
第二篇 PCB布局

在设计中，布局是一个重要的环节。布局结果的好坏将直接影响布线的效果，因此可以这样认为，合理的布局是PCB设计成功的步。
布局的方式分两种，一种是交互式布局，另一种是自动布局，一般是在自动布局的基础上用交互式布局进行调整，在布局时还可根据走线的情况对门电路进行再分配，将两个门电路进行交换，使其成为便于布线的佳布局。在布局完成后，还可对设计文件及有关信息进行返回标注于原理图，使得PCB板中的有关信息与原理图相一致，以便在今后的建档、更改设计能同步起来, 同时对模拟的有关信息进行更新，使得能对电路的电气性能及功能进行板级验证。

--考虑整体美观
一个产品的成功与否，一是要注重内在质量，二是兼顾整体的美观，两者都较才能认为该产品是成功的。
在一个PCB板上，元件的布局要求要均衡，疏密有序，不能头重脚轻或一头沉。

--布局的检查印制板尺寸是否与加工图纸尺寸相符？能否符合PCB制造工艺要求？有无定位标记？
元件在二维、三维空间上有无冲突？
元件布局是否疏密有序，排列整齐？是否全部布完？
需经常更换的元件能否方便的更换？插件板插入设备是否方便？
热敏元件与发热元件之间是否有适当的距离？
调整可调元件是否方便？
在需要散热的地方，装了散热器没有？空气流是否通畅？
信号流程是否顺畅且互连短？
插头、插座等与机械设计是否矛盾？
线路的干扰问题是否有所考虑？

PCB电路板无铅喷锡与有铅喷锡除了环保差异外，还有哪些区别呢？
随着电子行业不断的发展，PCB的技术水平也在水涨船高，常见的表面处理工艺就有喷锡，沉金，镀金，OSP等；其中喷锡分为无铅喷锡和有铅喷锡。那么，PCB电路板无铅喷锡与有铅喷锡的区别在哪？
1、无铅喷锡属于环保类工艺，不含有害物质"铅"，熔点在218度左右；锡炉温度需控制在280-300度；过波峰焊温度需控制在260度左右；过回流焊温度在260-270度左右。

2、有铅喷锡不属于环保类工艺，含有害物质"铅"，熔点183度左右；锡炉温度需控制在245-260度；过波峰焊温度需控制在250度左右；过回流焊温度在245-255度左右。

3、从锡的表面看，有铅锡比较亮，无铅锡比较暗淡；无铅板的浸润性要比有铅板的差一点。

4、无铅锡的铅含量不超过0.5 ，有铅锡的铅含量达到37。

5、铅会提高锡线在焊接过程中的活性，有铅锡线相对比无铅锡线好用；不过铅有毒，长期使用对人体不好。无铅锡比有铅锡熔点高，焊接点会牢固很多。

6、在pcb板表面处理中，通常做无铅喷锡和有铅喷锡的价格是一样的，没有区别。

什么是HDI线路板？
一.什么是HDI板？
HDI板（High Density Interconnector），即高密度互连板，是使用微盲埋孔技术的一种线路分布密度比较高的电路板。HDI板有内层线路和外层线路，再利用钻孔、孔内金属化等工艺，使各层线路内部实现连结。
二.HDI板与普通pcb的区别
HDI板一般采用积层法制造，积层的次数越多，板件的技术档次越高。普通的HDI板基本上是1次积层，高阶HDI采用2次或以上的积层技术，同时采用叠孔、电镀填孔、激光直接打孔等PCB技术。当PCB的密度增加超过八层板后，以HDI来制造，其成本将较传统复杂的压合制程来得低。
HDI板的电性能和讯号正确性比传统PCB更高。此外，HDI板对于射频干扰、电磁波干扰、静电释放、热传导等具有更佳的改善。高密度集成（HDI）技术可以使终端产品设计更加小型化，同时满足电子性能和效率的更高标准。
HDI板使用盲孔电镀 再进行二次压合，分一阶、二阶、三阶、四阶、五阶等。一阶的比较简单，流程和工艺都好控制。二阶的主要问题，一是对位问题，二是打孔和镀铜问题。二阶的设计有多种，一种是各阶错开位置，需要连接次邻层时通过导线在中间层连通，做法相当于2个一阶HDI。第二种是，两个一阶的孔重叠，通过叠加方式实现二阶，加工也类似两个一阶，但有很多工艺要点要特别控制，也就是上面所提的。第三种是直接从外层打孔至第3层（或N-2层），工艺与前面有很多不同，打孔的难度也更大。对于三阶的以二阶类推即是。

三.HDI板的优势
这种PCB在突显优势的基础上发展迅速：
1.HDI技术有助于降低PCB成本;
2.HDI技术增加了线密度;
3.HDI技术有利于使用的包装;
4.HDI技术具有更好的电气性能和信号有效性;
5.HDI技术具有更好的可靠性;
6.HDI技术在散热方面更好;
7.HDI技术能够改善RFI（射频干扰）/EMI（电磁干扰）/ESD（静电放电）;
8.HDI技术提高了设计效率;
四.HDI板的材料
对HDI PCB材料提出了一些新的要求，包括更好的尺寸稳定性，抗静电移动性和非胶粘剂。HDI PCB的典型材料是RCC（树脂涂层铜）。RCC有三种类型，即聚酰亚胺金属化薄膜，纯聚酰亚胺薄膜，流延聚酰亚胺薄膜。
RCC的优点包括：厚度小，重量轻，柔韧性和易燃性，兼容性特性阻抗和的尺寸稳定性。在HDI多层PCB的过程中，取代传统的粘接片和铜箔作为绝缘介质和导电层的作用，可以通过传统的抑制技术用芯片抑制RCC。然后使用非机械钻孔方法如激光，以便形成微通孔互连。
RCC推动PCB产品从SMT（表面贴装技术）到CSP的发生和发展（芯片级封装），从机械钻孔到激光钻孔，促进PCB微通孔的发展和进步，所有这些都成为RCC的HDI PCB材料。
在实际的PCB中在制造过程中，对于RCC的选择，通常有FR-4标准Tg 140C，FR-4高Tg 170C和FR-4和Rogers组合层压，现在大多使用。随着HDI技术的发展，HDI PCB材料满足更多要求，因此HDI PCB材料的主要趋势应该是：
1.使用无粘合剂的柔性材料的开发和应用;
2.介电层厚度小，偏差小;
3 .LPIC的发展;
4.介电常数越来越小;
5.介电损耗越来越小;
6.焊接稳定性高;
7.严格兼容CTE（热膨胀系数）;
五.HDI板制造的应用技术
HDI PCB制造的难点在于微观通过制造，通过金属化和细线。
1.微通孔制造
微通孔制造一直是HDI PCB制造的核心问题。主要有两种钻井方法：
a.对于普通的通孔钻孔，机械钻孔始终是其率和低成本的佳选择。随着机械加工能力的发展，其在微通孔中的应用也在不断发展。
b.有两种类型的激光钻孔：光热消融和光化学消融。前者是指在高能量吸收激光之后加热操作材料以使其熔化并且通过形成的通孔蒸发掉的过程。后者指的是紫外区高能光子和激光长度超过400nm的结果。
有三种类型的激光系统应用于柔性和刚性板，即准分子激光，紫外激光钻孔，CO 2 激光。激光技术不仅适用于钻孔，也适用于切割和成型。甚至一些制造商也通过激光制造HDI。虽然激光钻孔设备成本高，但它们具有更高的精度，稳定的工艺和成熟的技术。激光技术的优势使其成为盲/埋通孔制造中常用的方法。如今，在HDI微通孔中，99％是通过激光钻孔获得的。
2.通过金属化
通孔金属化的大困难是电镀难以达到均匀。对于微通孔的深孔电镀技术，除了使用具有高分散能力的电镀液外，还应及时升级电镀装置上的镀液，这可以通过强力机械搅拌或振动，超声波搅拌，水平喷涂。此外，在电镀前增加通孔壁的湿度。
除了工艺的改进外，HDI的通孔金属化方法也看到了主要技术的改进：化学镀添加剂技术，直接电镀技术等。
3.细线
细线的实现包括传统的图像传输和激光直接成像。传统的图像转移与普通化学蚀刻形成线条的过程相同。
对于激光直接成像，不需要摄影胶片，而图像是通过激光直接在光敏膜上形成的。紫外波灯用于操作，使液体防腐解决方案能够满足高分辨率和简单操作的要求。不需要摄影胶片，以避免因薄膜缺陷造成的不良影响，可以直接连接CAD/CAM，缩短制造周期，使其适用于和多种生产。

超实用的高频PCB电路设计70问答之一
1、如何选择PCB 板材？

选择PCB板材在满足设计需求和可量产性及成本中间取得平衡点。设计需求包含电气和机构这两部分。通常在设计非常高速的 PCB 板子(大于 GHz 的频率)时这材质问题会比较重要。例如，现在常用的 FR-4 材质，在几个GHz 的频率时的介质损耗(dielectric loss)会对信号衰减有很大的影响，可能就不合用。就电气而言，要注意介电常数(dielectric constant)和介质损在所设计的频率是否合用。



2、如何避免高频干扰？

避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加 ground guard/shunt traces 在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。



3、在高速设计中，如何解决信号的完整性问题？

信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impedance)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。



4、差分布线方式是如何实现的？

差分对的布线有两点要注意，一是两条线的长度要尽量一样长，另一是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层(side-by-side)，一为两条线走在上下相邻两层(over-under)。一般以前者 side-by-side(并排, 并肩) 实现的方式较多。



5、对于只有一个输出端的时钟信号线，如何实现差分布线？

要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。



6、接收端差分线对之间可否加一匹配电阻？

接收端差分线对间的匹配电阻通常会加, 其值应等于差分阻抗的值。这样信号质量会好些。



7、为何差分对的布线要靠近且平行？

对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗(differential impedance)的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性(signal integrity)及时间延迟(timing delay)。



8、如何处理实际布线中的一些理论冲突的问题

基本上, 将模/数地分割隔离是对的。 要注意的是信号走线尽量不要跨过有分割的地方(moat), 还有不要让电源和信号的回流电流路径(returning current path)变太大。



晶振是模拟的正反馈振荡电路, 要有稳定的振荡信号, 满足loop gain 与 phase 的规范, 而这模拟信号的振荡规范很容易受到干扰, 即使加 ground guard traces 可能也无法完全隔离干扰。而且离的太远,地平面上的噪声也会影响正反馈振荡电路。 所以, 一定要将晶振和芯片的距离进可能靠近。



确实高速布线与 EMI 的要求有很多冲突。但基本原则是因 EMI 所加的电阻电容或 ferrite bead, 不能造成信号的一些电气特性不符合规范。 所以, 好先用安排走线和 PCB 迭层的技巧来解决或减少 EMI的问题, 如高速信号走内层。后才用电阻电容或 ferrite bead 的方式, 以降低对信号的伤害。



9、如何解决高速信号的手工布线和自动布线之间的矛盾？

现在较强的布线软件的自动布线器大部分都有设定约束条件来控制绕线方式及过孔数目。各家 EDA公司的绕线引擎能力和约束条件的设定项目有时相差甚远。 例如, 是否有足够的约束条件控制蛇行线(serpentine)蜿蜒的方式, 能否控制差分对的走线间距等。 这会影响到自动布线出来的走线方式是否能符合设计者的想法。 另外, 手动调整布线的难易也与绕线引擎的能力有的关系。 例如, 走线的推挤能力,过孔的推挤能力, 甚至走线对敷铜的推挤能力等等。 所以, 选择一个绕线引擎能力强的布线器, 才是解决之道。



10、关于 test coupon。

test coupon 是用来以 TDR (Time Domain Reflectometer) 测量所生产的 PCB 板的特性阻抗是否满足设计需求。 一般要控制的阻抗有单根线和差分对两种情况。 所以， test coupon 上的走线线宽和线距(有差分对时)要与所要控制的线一样。 重要的是测量时接地点的位置。 为了减少接地引线(ground lead)的电感值， TDR 探棒(probe)接地的地方通常非常接近量信号的地方(probe tip)， 所以， test coupon 上量测信号的点跟接地点的距离和方式要符合所用的探棒。



11、在高速 PCB 设计中，信号层的空白区域可以敷铜，而多个信号层的敷铜在接地和接电源上应如何分配？

一般在空白区域的敷铜绝大部分情况是接地。 只是在高速信号线旁敷铜时要注意敷铜与信号线的距离， 因为所敷的铜会降低一点走线的特性阻抗。也要注意不要影响到它层的特性阻抗， 例如在 dual strip line 的结构时。

12、是否可以把电源平面上面的信号线使用微带线模型计算特性阻抗？电源和地平面之间的信号是否可以使用带状线模型计算？

是的， 在计算特性阻抗时电源平面跟地平面都视为参考平面。 例如四层板: 顶层-电源层-地层-底层，这时顶层走线特性阻抗的模型是以电源平面为参考平面的微带线模型。



13、在高密度印制板上通过软件自动产生测试点一般情况下能满足大批量生产的测试要求吗？

一般软件自动产生测试点是否满足测试需求看对加测试点的规范是否符合测试机具的要求。另外，如果走线太密且加测试点的规范比较严，则有可能没办法自动对每段线都加上测试点，当然，需要手动补齐所要测试的地方。



14、添加测试点会不会影响高速信号的质量？

至于会不会影响信号质量就要看加测试点的方式和信号到底多快而定。基本上外加的测试点(不用在线既有的穿孔(via or DIP pin)当测试点)可能加在在线或是从在线拉一小段线出来。前者相当于是加上一个很小的电容在在线，后者则是多了一段分支。这两个情况都会对高速信号多多少少会有点影响，影响的程度就跟信号的频率速度和信号缘变化率(edge rate)有关。影响大小可透过仿真得知。原则上测试点越小越好(当然还要满足测试机具的要求)分支越短越好。



15、若干 PCB 组成系统，各板之间的地线应如何连接？

各个 PCB 板子相互连接之间的信号或电源在动作时，例如 A 板子有电源或信号送到 B 板子，一定会有等量的电流从地层流回到 A 板子 (此为 Kirchoff current law)。这地层上的电流会找阻抗小的地方流回去。所以，在各个不管是电源或信号相互连接的接口处，分配给地层的管脚数不能太少，以降低阻抗，这样可以降低地层上的噪声。另外，也可以分析整个电流环路，尤其是电流较大的部分，调整地层或地线的接法，来控制电流的走法(例如，在某处制造低阻抗，让大部分的电流从这个地方走)，降低对其它较敏感信号的影响。



16、能介绍一些国外关于高速 PCB 设计的技术书籍和数据吗？

现在高速数字电路的应用有通信网路和计算器等相关领域。在通信网路方面，PCB 板的工作频率已达 GHz 上下，叠层数就我所知有到 40 层之多。计算器相关应用也因为芯片的进步，无论是一般的 PC 或服务器(Server)，板子上的高工作频率也已经达到 400MHz (如 Rambus) 以上。因应这高速高密度走线需求，盲埋孔(blind/buried vias)、mircrovias 及 build-up 制程工艺的需求也渐渐越来越多。 这些设计需求都有厂商可大量生产。



17、两个常被参考的特性阻抗公式：

微带线(microstrip) Z={87/[sqrt(Er+1.41)]}ln[5.98H/(0.8W+T)] 其中，W 为线宽，T 为走线的铜皮厚度，H 为走线到参考平面的距离，Er 是 PCB 板材质的介电常数(dielectric constant)。此公式在0.1<(W/H)<2.0 及 1<(Er)<15 的情况才能应用。



带状线(stripline) Z=[60/sqrt(Er)]ln{4H/[0.67π(T+0.8W)]} 其中，H 为两参考平面的距离，并且走线位于两参考平面的中间。此公式在 W/H<0.35 及 T/H<0.25 的情况才能应用。



18、差分信号线中间可否加地线？

差分信号中间一般是不能加地线。因为差分信号的应用原理重要的一点便是利用差分信号间相互耦合(coupling)所带来的好处，如 flux cancellation，抗噪声(noise immunity)能力等。若在中间加地线，便会破坏耦合效应。



19、刚柔板设计是否需要设计软件与规范？国内何处可以承接该类电路板加工？

可以用一般设计 PCB 的软件来设计柔性电路板(Flexible Printed Circuit)。一样用 Gerber 格式给 FPC厂商生产。由于制造的工艺和一般 PCB 不同，各个厂商会依据他们的制造能力会对小线宽、小线距、小孔径(via)有其**。除此之外，可在柔性电路板的转折处铺些铜皮加以补强。至于生产的厂商可上网“FPC”当关键词查询应该可以找到。



20、适当选择 PCB 与外壳接地的点的原则是什么？

选择 PCB 与外壳接地点选择的原则是利用 chassis ground 提供低阻抗的路径给回流电流(returning current)及控制此回流电流的路径。例如，通常在高频器件或时钟产生器附近可以借固定用的螺丝将 PCB的地层与 chassis ground 做连接，以尽量缩小整个电流回路面积，也就减少电磁辐射。

超实用的高频PCB电路设计70问答之三

26、当一块 PCB 板中有多个数/模功能块时，常规做法是要将数/模地分开，原因何在？

将数/模地分开的原因是因为数字电路在高低电位切换时会在电源和地产生噪声，噪声的大小跟信号的速度及电流大小有关。如果地平面上不分割且由数字区域电路所产生的噪声较大而模拟区域的电路又非常接近，则即使数模信号不交叉，模拟的信号依然会被地噪声干扰。也就是说数模地不分割的方式只能在模拟电路区域距产生大噪声的数字电路区域较远时使用。

27、另一种作法是在确保数/模分开布局，且数/模信号走线相互不交叉的情况下，整个 PCB板地不做分割，数/模地都连到这个地平面上。道理何在？

数模信号走线不能交叉的要求是因为速度稍快的数字信号其返回电流路径(return current path)会尽量沿着走线的下方附近的地流回数字信号的源头，若数模信号走线交叉，则返回电流所产生的噪声便会出现在模拟电路区域内。

28、在高速 PCB 设计原理图设计时，如何考虑阻抗匹配问题？

在设计高速 PCB 电路时，阻抗匹配是设计的要素之一。而阻抗值跟走线方式有的关系，例如是走在表面层(microstrip)或内层(stripline/double stripline)，与参考层(电源层或地层)的距离，走线宽度，PCB材质等均会影响走线的特性阻抗值。也就是说要在布线后才能确定阻抗值。一般仿真软件会因线路模型或所使用的数学算法的**而无法考虑到一些阻抗不连续的布线情况，这时候在原理图上只能预留一些terminators(端接)，如串联电阻等，来缓和走线阻抗不连续的效应。真正根本解决问题的方法还是布线时尽量注意避免阻抗不连续的发生。

29、哪里能提供比较准确的 IBIS 模型库？

IBIS 模型的准确性直接影响到仿真的结果。基本上 IBIS 可看成是实际芯片 I/O buffer 等效电路的电气特性数据，一般可由 SPICE 模型转换而得 ，而 SPICE 的数据与芯片制造有的关系，所以同样一个器件不同芯片厂商提供，其 SPICE 的数据是不同的，进而转换后的 IBIS 模型内之数据也会随之而异。也就是说，如果用了 A 厂商的器件，只有他们有能力提供他们器件准确模型数据，因为没有其它人会比他们更清楚他们的器件是由何种工艺做出来的。如果厂商所提供的 IBIS 不准确，只能不断要求该厂商改进才是根本解决之道。

30、在高速 PCB 设计时，设计者应该从那些方面去考虑 EMC、EMI 的规则呢？

一般 EMI/EMC 设计时需要同时考虑辐射(radiated)与传导(conducted)两个方面. 前者归属于频率较高的部分(>30MHz)后者则是较低频的部分(<30MHz). 所以不能只注意高频而忽略低频的部分。一个好的EMI/EMC 设计一开始布局时就要考虑到器件的位置， PCB 叠层的安排, 重要联机的走法, 器件的选择等, 如果这些没有事前有较佳的安排, 事后解决则会事倍功半, 增加成本.。



例如时钟产生器的位置尽量不要靠近对外的连接器, 高速信号尽量走内层并注意特性阻抗匹配与参考层的连续以减少反射， 器件所推的信号之斜率(slew rate)尽量小以减低高频成分，选择去耦合(decoupling/bypass)电容时注意其频率响应是否符合需求以降低电源层噪声。另外, 注意高频信号电流之回流路径使其回路面积尽量小(也就是回路阻抗loop impedance 尽量小)以减少辐射。还可以用分割地层的方式以控制高频噪声的范围. 后, 适当的选择PCB 与外壳的接地点(chassis ground)。

31、如何选择 EDA 工具？

目前的 pcb 设计软件中，热分析都不是强项，所以并不建议选用，其它的功能 1.3.4 可以选择 PADS或 Cadence 性能价格比都不错。 PLD 的设计的初学者可以采用 PLD 芯片厂家提供的集成环境，在做到百万门以上的设计时可以选用单点工具。

32、请推荐一种适合于高速信号处理和传输的 EDA 软件。

常规的电路设计，INNOVEDA 的 PADS 就非常不错，且有配合用的仿真软件，而这类设计往往占据了 70%的应用场合。在做高速电路设计，模拟和数字混合电路，采用 Cadence 的解决方案应该属于性能价格比较好的软件，当然 Mentor 的性能还是非常不错的，特别是它的设计流程管理方面应该是为的。（大唐电信技术 王升）

33、对 PCB 板各层含义的解释

Topoverlay ----顶层器件名称， 也叫 top silkscreen 或者 top component legend, 比如 R1 C5,

IC10.bottomoverlay----同理 multilayer-----如果你设计一个 4 层板，你放置一个 free pad or via, 定义它作为multilay 那么它的 pad 就会自动出现在 4 个层 上，如果你只定义它是 top layer, 那么它的 pad 就会只出现在顶层上。



34、2G 以上高频 PCB 设计，走线,排版,应注意哪些方面？

2G 以上高频 PCB 属于射频电路设计，不在高速数字电路设计讨论范围内。而 射频电路的布局（layout)和布线（routing)应该和原理图一起考虑的，因为布局布线都会造成分布效应。而且，射频电路设计一些无源器件是通过参数化定义，特殊形状铜箔实现，因此要求 EDA 工具能够提供参数化器件，能够编辑特殊形状铜箔。Mentor 公司的 boardstation 中有的 RF 设计模块，能够满足这些要求。而且，一般射频设计要求有射频电路分析工具，业界的是 agilent 的 eesoft，和 Mentor 的工具有很好的接口。

35、2G 以上高频 PCB 设计，微带的设计应遵循哪些规则?

射频微带线设计，需要用三维场分析工具提取传输线参数。所有的规则应该在这个场提取工具中规定。

超实用的高频PCB电路设计70问答 之四

36、对于全数字信号的 PCB，板上有一个 80MHz 的钟源。除了采用丝网（接地）外，为了有足够的驱动能力，还应该采用什么样的电路进行保护？

确保时钟的驱动能力，不应该通过保护实现，一般采用时钟驱动芯片。一般担心时钟驱动能力，是因为多个时钟负载造成。采用时钟驱动芯片，将一个时钟信号变成几个，采用点到点的连接。选择驱动芯片，除了与负载基本匹配，信号沿满足要求（一般时钟为沿有效信号），在计算系统时序时，要算上时钟在驱动芯片内时延。

37、如果用单的时钟信号板，一般采用什么样的接口，来时钟信号的传输受到的影响小？

时钟信号越短，传输线效应越小。采用单的时钟信号板，会增加信号布线长度。而且单板的接地供电也是问题。如果要长距离传输，建议采用差分信号。LVDS 信号可以满足驱动能力要求，不过您的时钟不是太快，没有必要。

38、27M,SDRAM 时钟线（80M-90M），这些时钟线二三次谐波刚好在 VHF 波段，从接收端高频窜入后干扰很大。除了缩短线长以外，还有那些好办法？

如果是三次谐波大，二次谐波小，可能因为信号占空比为 50%，因为这种情况下，信号没有偶次谐波。这时需要修改一下信号占空比。此外，对于如果是单向的时钟信号，一般采用源端串联匹配。这样可以抑制二次反射，但不会影响时钟沿速率。源端匹配值，可以采用下图公式得到。

39、什么是走线的拓扑架构？

Topology,有的也叫 routing order.对于多端口连接的网络的布线次序。

40、怎样调整走线的拓扑架构来提高信号的完整性？

这种网络信号方向比较复杂，因为对单向，双向信号，不同电平种类信号，拓朴影响都不一样，很难说哪种拓朴对信号质量有利。而且作前仿真时，采用何种拓朴对工程师要求很高，要求对电路原理，信号类型，甚至布线难度等都要了解。

41、怎样通过安排叠层来减少 EMI 问题？

，EMI 要从系统考虑，单凭 PCB 无法解决问题。层迭对 EMI 来讲，我认为主要是提供信号短回流路径，减小耦合面积，抑制差模干扰。另外地层与电源层紧耦合，适当比电源层外延，对抑制共模干扰有好处。



42、为何要铺铜？

一般铺铜有几个方面原因。１，EMC.对于大面积的地或电源铺铜，会起到屏蔽作用，有些特殊地，如 PGND 起到防护作用。２，PCB 工艺要求。一般为了电镀效果，或者层压不变形，对于布线较少的PCB 板层铺铜。３，信号完整性要求，给高频数字信号一个完整的回流路径，并减少直流网络的布线。当然还有散热，特殊器件安装要求铺铜等等原因。

43、在一个系统中，包含了dsp和 pld，请问布线时要注意哪些问题呢？

看你的信号速率和布线长度的比值。如果信号在传输在线的时延和信号变化沿时间可比的话，就要考虑信号完整性问题。另外对于多个 DSP，时 钟，数据 信号走线拓普也会影响信号质量和时序，需要关注。

44、除 protel 工具布线外，还有其他好的工具吗？

至于工具，除了 PROTEL，还有很多布线工具，如 MENTOR 的 WG2000,EN2000 系列和 powerpcb，Cadence 的 allegro，zuken 的 cadstar,cr5000 等，各有所长。

45、什么是“信号回流路径”？

信号回流路径,即 return current。高速数字信号在传输时，信号的流向是从驱动器沿 PCB 传输线到负载，再由负载沿着地或电源通过短路径返回驱动器端。这个在地或电源上的返回信号就称信号回流路径。Dr.Johson 在他的书中解释，高频信号传输，实际上是对传输线与直流层之间包夹的介质电容充电的过程。SI 分析的就是这个围场的电磁特性，以及他们之间的耦合。

46、如何对接插件进行SI分析？

在 IBIS3.2 规范中，有关于接插件模型的描述。一般使用 EBD 模型。如果是特殊板，如背板，需要SPICE 模型。也可以使用多板仿真软件（HYPERLYNX 或 IS_multiboard），建立多板系统时，输入接插件的分布参数，一般从接插件手册中得到。当然这种方式会不够，但只要在可接受范围内即可。

47、请问端接的方式有哪些？

端接（terminal）,也称匹配。一般按照匹配位置分有源端匹配和终端匹配。其中源端匹配一般为电阻串联匹配，终端匹配一般为并联匹配，方式比较多，有电阻上拉，电阻下拉，戴维南匹配，AC 匹配，肖特基二极管匹配。

48、采用端接（匹配）的方式是由什么因素决定的？

匹配采用方式一般由 BUFFER 特性，拓普情况，电平种类和判决方式来决定，也要考虑信号占空比，系统功耗等。

49、采用端接（匹配）的方式有什么规则？

数字电路关键的是时序问题，加匹配的目的是改善信号质量，在判决时刻得到可以确定的信号。对于电平有效信号，在建立、保持时间的前提下，信号质量稳定；对延有效信号，在信号延单调性前提下，信号变化延速度满足要求。Mentor ICX 产品教材中有关于匹配的一些资料。另外《High Speed Digital design a hand book of blackmagic》有一章对 terminal 的讲述，从电磁波原理上讲述匹配对信号完整性的作用，可供参考。

50、能否利用器件的 IBIS 模型对器件的逻辑功能进行仿真？如果不能，那么如何进行电路的板级和系统级仿真？

IBIS 模型是行为级模型，不能用于功能仿真。功能仿真，需要用 SPICE 模型，或者其他结构级模型。